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波周期

使能模块的输入端为行列式键盘

字号+ 作者:admin 来源:未知 2018-11-27 02:52 我要评论( )

( 2) D/ A 转换器非线性惹起的杂散分量。抱负DAC 对DDS 的影响只表此刻对信号频谱的幅度和相位发生改变, 输出上表现出滚降特征, 并不引入其它的频次成分, 而非抱负的DAC 的非线性、霎时毛刺等非抱负的转换特征在输出频谱中发生了杂散。 还能够采用相位

  ( 2) D/ A 转换器非线性惹起的杂散分量。抱负DAC 对DDS 的影响只表此刻对信号频谱的幅度和相位发生改变, 输出上表现出滚降特征, 并不引入其它的频次成分, 而非抱负的DAC 的非线性、霎时毛刺等非抱负的转换特征在输出频谱中发生了杂散。

  还能够采用相位误差反馈布局, 在SCMF( 相位累加器和正余弦函数生成器) 前插手一个二阶FIR 滤波器( Finite Impulse Response, 无限冲击响应) 来滤除输出频次附近的相位误差。

  通过设定预定值, 用计数器丈量呈现实值, 基于此数据计较出误差如下表( 只拔取10 组数据) 。

  DDS 次要有相位累加器、ROM 波形查询表、数模转换器构成。其根基框图如图1 所示。

  DDS( Direct Digital Sy nthesis) 的概念由美国粹者J. T ier ncy、C. M. Rader 和B. Gold 在1971 年提出。波形周期该手艺是从相位的概念进行频次合成, 次要长处是输出相位持续、相对带宽较大、频次分辩率很高、可编程、精确度和不变度都比力高 。DDS 手艺是操纵查表法来发生波形, 而通过点窜存储在ROM 里的数据, 就能够发生肆意波形。

  本案采用德州仪器的TLC7528。它是双路、8 位D/ A 转换器, 本案设想为: A 路的数字量节制B 路的电压输出, B 路则节制输出的幅度。电路图能够显示,VA1( VOB1) 处输入的A( B) 路电压范畴为- 5~ 0 V,VA2( VOB2) 处为A( B) 路的电压为- 5~ 5 V。DA 电路毗连图如图3 所示。

  基于FPGA 实现DDS 功能, 通过单片机实现节制。此方案的焦点在于FPGA 的设想实现逻辑功能,通过对存储器查表后输出信号, 由相毗连的数模转换器转换为要求的波形。单片机作为节制器, 易于节制与调试。系统框图如图2 所示。

  由表1 可看出, 1 ~ 100 Hz 区间误差较为较着,1 kHz~ 1 MHz区间输出频次较为不变( 该表为测试正弦波数据) 。

  单片机采用保守8051 单片机, 晶振为12 MHz, 采用内部振荡体例; 复位输入引脚为高电平无效, 连结2 个机械周期以上的的高电平便能够实现对单片机的复位; 采用MAX232 芯片作为串口芯片,波形周期 单片机通过异步通信串行接口与其他计较机或者外围设备进行消息传送。

  减小DDS 输出电压中的杂散及噪声的方式, 除了选用机能优秀、工艺精深的D/ A 转换器, 提高位数与幅怀抱化字长外, 还能够通过设想优良的低通滤波器, 以滤除各类杂散及带外噪声, 也可选用DDS+ PLL 频次合成手艺, 以及数据压缩法, 最高压缩比可达128 1。别的能够在发生的相位字序列上插手高频发抖( Dither) , 由于相位截位误差成周期分布, 这将导致在某些频次处发生较大的毛刺, 使DDS 发生的频谱无杂波动态范畴减小。通过在相位上插手发抖, 可以或许粉碎相位误差中较较着的周期性分布, 从而使得毛刺的幅值获得减小, 增

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